Récepteur LVDS, DS90CF386MTD/NOPB, 28 LVCMOS 2380Mbps, TSSOP, 56 broches
Documents techniques
Spécifications
Brand
Texas InstrumentsNombre de drivers
28
Type d'entrée
LVDS
Interface
CI pour récepteur
Type de sortie
LVCMOS
Taux de transfert de données
2380Mbps
Nombre d'éléments par circuit
3
Type de montage
CMS
Type d'emballage
TSSOP-56
Nombre de broche
56
Tension de seuil haute d'entrée différentielle
100mV
Tension de seuil basse d'entrée différentielle
-100mV
Dimensions
14 x 6.1 x 0.9mm
Taille
0.9mm
Longueur
14mm
Tension d'alimentation fonctionnement maximum
3.6 V
Température d'utilisation maximum
70 °C
Largeur
6.1mm
Température de fonctionnement minimum
-10 °C
Tension d'alimentation de fonctionnement minimum
3 V
Détails du produit
Sérialiseur/désérialiseur FlatLink/FPD-Link, Texas Instruments
Emetteurs LVDS à utiliser avec les liaisons FPD de 24 bits (écran plat) fonctionnant à 65 et 85 MHz.
Entrées LVCMOS/LVTTL
Fonctionnement à faible alimentation de 3,3 V
Horloge de données d'émetteur PLL
Conforme à la norme TIA/EIA-644 LVDS
LVDS Communication
Low Voltage Differential Signaling, or LVDS, is an electrical signaling system that can run at very high speeds over cheap, twisted-pair copper cables.
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€ 176,95
€ 5,204 Each (In a Tube of 34) (hors TVA)
34
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| Quantité | Prix unitaire | Par Tube |
|---|---|---|
| 34 - 34 | € 5,204 | € 176,95 |
| 68 - 136 | € 5,071 | € 172,42 |
| 170+ | € 4,944 | € 168,11 |
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LVDS
Interface
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Type de sortie
LVCMOS
Taux de transfert de données
2380Mbps
Nombre d'éléments par circuit
3
Type de montage
CMS
Type d'emballage
TSSOP-56
Nombre de broche
56
Tension de seuil haute d'entrée différentielle
100mV
Tension de seuil basse d'entrée différentielle
-100mV
Dimensions
14 x 6.1 x 0.9mm
Taille
0.9mm
Longueur
14mm
Tension d'alimentation fonctionnement maximum
3.6 V
Température d'utilisation maximum
70 °C
Largeur
6.1mm
Température de fonctionnement minimum
-10 °C
Tension d'alimentation de fonctionnement minimum
3 V
Détails du produit
Sérialiseur/désérialiseur FlatLink/FPD-Link, Texas Instruments
Emetteurs LVDS à utiliser avec les liaisons FPD de 24 bits (écran plat) fonctionnant à 65 et 85 MHz.
Entrées LVCMOS/LVTTL
Fonctionnement à faible alimentation de 3,3 V
Horloge de données d'émetteur PLL
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