Porte NAND quadruple à 2 entrées Non 4 NAND Nexperia HC Drain ouvert 5.2 mA, 14 broches SOIC 2
Documents techniques
Spécifications
Brand
NexperiaFonction logique
NAND
Type de produit
Porte NAND quadruple à 2 entrées
Type de montage
Surface
Nombre d'éléments
4
Nombre d'entrées par porte
2
Entrée de trigger de Schmitt
No
Type de Boitier
SOIC
Nombre de broches
14
Famille logique
HC
Type d'entrée
CMOS
Délai de propagation maximum @ CL
29ns
Température de fonctionnement minimum
-40°C
Courant maximum de sortie niveau haut
-5.2mA
Température d'utilisation maximum
125°C
Normes/homologations
JEDEC Standard No. 7A
Tension d'alimentation minimale
2V
Largeur
4 mm
Séries
74HC03
Tension d'alimentation maximum
6V
Taille
1.45mm
Longueur
8.75mm
Tension maximale de sortie niveau bas
5.2mA
Standard automobile
No
Type de sortie
Open Drain
Pays d'origine
Thailand
Détails du produit
Portes logiques de famille 74HC, Nexperia
Une gamme de portes logiques standard NXP de la famille 74HC de circuits intégrés logiques CMOS. La famille 74HC utilise la technologie de grille silicium CMOS pour atteindre des vitesses de fonctionnement similaires à celles de la famille LSTTL mais avec la faible consommation des circuits intégrés CMOS standards.
Logique CMOS ultra-rapide
Tension d'utilisation : 2 à 6 V
Compatibilité : Entrée CMOS, Sortie CMOS
74HC Family
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Les informations sur le stock sont temporairement indisponibles.
€ 5,20
€ 0,091 Each (In a Tube of 57) (hors TVA)
57
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Type d'entrée
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Température de fonctionnement minimum
-40°C
Courant maximum de sortie niveau haut
-5.2mA
Température d'utilisation maximum
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JEDEC Standard No. 7A
Tension d'alimentation minimale
2V
Largeur
4 mm
Séries
74HC03
Tension d'alimentation maximum
6V
Taille
1.45mm
Longueur
8.75mm
Tension maximale de sortie niveau bas
5.2mA
Standard automobile
No
Type de sortie
Open Drain
Pays d'origine
Thailand
Détails du produit
Portes logiques de famille 74HC, Nexperia
Une gamme de portes logiques standard NXP de la famille 74HC de circuits intégrés logiques CMOS. La famille 74HC utilise la technologie de grille silicium CMOS pour atteindre des vitesses de fonctionnement similaires à celles de la famille LSTTL mais avec la faible consommation des circuits intégrés CMOS standards.
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