Porte Logique Non 4 Mémoire tampon et driver de ligne Nexperia HC 3 états 7.8 mA, 14 broches SOIC 4

N° de stock RS: 103-8171Marque: NexperiaN° de pièce Mfr: 74HC125D,652
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Documents techniques

Spécifications

Typ produktu

Porte Logique

Logická funkce

Mémoire tampon et driver de ligne

Typ montáže

Surface

Nombre d'éléments

4

Počet vstupů na bránu

4

Vstup Schmittův klopný obvod

No

Type de Boitier

SOIC

Nombre de broche

14

Řada logiky

HC

Type d'entrée

Single Ended

Délai de propagation maximum @ CL

26ns

Température minimum de fonctionnement

80°C

Courant maximum de sortie niveau haut

-7.8mA

Maximální provozní teplota

60°C

Tension d'alimentation minimale

2V

Höhe

1.45mm

Longueur

8.75mm

Normes/homologations

No

Tension d'alimentation maximum

6V

Tension maximale de sortie niveau bas

7.8mA

Automobilový standard

No

Type de sortie

3 State

Détails du produit

Inverseurs et mémoires tampon de la famille 74HC, Nexperia

Une gamme de d'inverseurs et mémoires tampons NXP de la famille 74HC de circuits intégrés logiques CMOS. La famille 74HC utilise la technologie de grille silicium CMOS pour atteindre des vitesses de fonctionnement similaires à celles de la famille LSTTL mais avec la faible consommation des circuits intégrés CMOS standards.

Logique CMOS ultra-rapide
Tension d'utilisation : 2 à 6 V
Compatibilité : Entrée CMOS, Sortie CMOS

74HC Family

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Vous pouvez être intéressé par
Porte logique CMS Nexperia Buffer, Driver de ligne SOIC, 14 broches
Prix ​​sur demandeEach (Supplied in a Tube) (hors TVA)
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Les informations sur le stock sont temporairement indisponibles.

Prix ​​sur demande

Each (In a Tube of 57) (hors TVA)

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14

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HC

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80°C

Courant maximum de sortie niveau haut

-7.8mA

Maximální provozní teplota

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2V

Höhe

1.45mm

Longueur

8.75mm

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No

Tension d'alimentation maximum

6V

Tension maximale de sortie niveau bas

7.8mA

Automobilový standard

No

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Une gamme de d'inverseurs et mémoires tampons NXP de la famille 74HC de circuits intégrés logiques CMOS. La famille 74HC utilise la technologie de grille silicium CMOS pour atteindre des vitesses de fonctionnement similaires à celles de la famille LSTTL mais avec la faible consommation des circuits intégrés CMOS standards.

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