Porte logique CMS Texas Instruments NAND double SOIC, 14 broches
Documents techniques
Spécifications
Brand
Texas InstrumentsLogic Function
NAND
Mounting Type
Surface Mount
Number Of Elements
2
Number of Inputs per Gate
4
Schmitt Trigger Input
No
Package Type
SOIC
Pin Count
14
Logic Family
HC
Maximum Operating Supply Voltage
6 V
Maximum High Level Output Current
-5.2mA
Maximum Propagation Delay Time @ Maximum CL
110 ns @ 2 V, 19 ns @ 6 V, 22 ns @ 4.5 V
Minimum Operating Supply Voltage
2 V
Maximum Low Level Output Current
5.2mA
Width
3.91mm
Minimum Operating Temperature
-40 °C
Dimensions
8.65 x 3.91 x 1.58mm
Maximum Operating Temperature
+85 °C
Propagation Delay Test Condition
50pF
Length
8.65mm
Height
1.58mm
Détails du produit
Portes logiques de la famille 74HC, Texas Instruments
Gamme de portes logiques standard de Texas Instruments de la famille 74HC de CI logiques CMOS. La famille 74HC utilise la technologie CMOS de porte en silicium pour obtenir des vitesses de fonctionnement similaires à celles de la famille LSTTL mais avec la faible consommation en puissance des circuits intégrés CMOS standard.
Logique CMOS ultra-rapide
Tension d'utilisation : 2 à 6 V
Compatibilité : Entrée CMOS, Sortie CMOS
74HC Family
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Les informations sur le stock sont temporairement indisponibles.
Prix sur demande
Each (On a Reel of 2500) (hors TVA)
2500
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2
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4
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No
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SOIC
Pin Count
14
Logic Family
HC
Maximum Operating Supply Voltage
6 V
Maximum High Level Output Current
-5.2mA
Maximum Propagation Delay Time @ Maximum CL
110 ns @ 2 V, 19 ns @ 6 V, 22 ns @ 4.5 V
Minimum Operating Supply Voltage
2 V
Maximum Low Level Output Current
5.2mA
Width
3.91mm
Minimum Operating Temperature
-40 °C
Dimensions
8.65 x 3.91 x 1.58mm
Maximum Operating Temperature
+85 °C
Propagation Delay Test Condition
50pF
Length
8.65mm
Height
1.58mm
Détails du produit
Portes logiques de la famille 74HC, Texas Instruments
Gamme de portes logiques standard de Texas Instruments de la famille 74HC de CI logiques CMOS. La famille 74HC utilise la technologie CMOS de porte en silicium pour obtenir des vitesses de fonctionnement similaires à celles de la famille LSTTL mais avec la faible consommation en puissance des circuits intégrés CMOS standard.
Logique CMOS ultra-rapide
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