Inverseur 6 Texas Instruments Inverseur LVC Pousser-tirer, CMOS 14 broches SOIC Entrée de trigger de Schmitt

N° de stock RS: 528-117Marque: Texas InstrumentsN° de pièce Mfr: SN74LVC14ADR
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Documents techniques

Spécifications

Fonction logique

Inverter

Type du produit

Inverter

Type d'entrée

Trigger de Schmitt

Type de sortie

Pousser-tirer, CMOS

Nombre d'éléments par circuit

6

Entrée de trigger de Schmitt

Yes

Délai de propagation maximum @ CL

9.5ns

Courant maximum de sortie niveau haut

-24mA

Tension maximale de sortie niveau bas

24mA

Tension d'alimentation minimale

1.65V

Type de support

Surface

Tension maximale d'alimentation

3.6V

Type de Boitier

SOIC

Nombre de broches

14

Température d'utilisation minimum

-40°C

Famille logique

LVC

Température d'utilisation maximum

125°C

Largeur

3.91 mm

Taille

1.58mm

Longueur

8.65mm

Normes/homologations

No

Séries

SN74LVC14A

Standard automobile

No

Détails du produit

Inverseurs et tampons, famille 74LVC, Texas Instruments

Gamme d'inverseurs et de tampons de Texas Instruments de la famille 74LVC de CI logiques CMOS basse tension. La famille 74LVC utilise la technologie CMOS de portes de silicium et est conçue pour fonctionner à 3,3 V, ce qui permet une réduction significative de la consommation par rapport aux systèmes de 5 V.

Tension d'utilisation : 1,65 → 3,6 V
Entrées tolérantes 5 V
Compatibilité : Entrée LVTTL/TTL, Sortie LVCMOS
Les performances du verrouillage dépassent 250 mA par JESD 17
La protection ESD dépasse JESD 22

74LVC Family

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€ 7,02

€ 0,281 Each (In a Pack of 25) (hors TVA)

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QuantitéPrix unitairePar Paquet
25 - 100€ 0,281€ 7,02
125 - 225€ 0,267€ 6,68
250 - 600€ 0,241€ 6,01
625 - 1225€ 0,216€ 5,41
1250+€ 0,205€ 5,12

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Tension d'alimentation minimale

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Surface

Tension maximale d'alimentation

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SOIC

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14

Température d'utilisation minimum

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Famille logique

LVC

Température d'utilisation maximum

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Largeur

3.91 mm

Taille

1.58mm

Longueur

8.65mm

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No

Séries

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No

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Tension d'utilisation : 1,65 → 3,6 V
Entrées tolérantes 5 V
Compatibilité : Entrée LVTTL/TTL, Sortie LVCMOS
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