Documents techniques
Spécifications
Brand
Texas InstrumentsFamille logique
LVC
Fonction logique
Buffer à trigger de Schmitt
Nombre de canaux
3
Entrée de trigger de Schmitt
Yes
Type d'entrée
Single Ended
Polarité
Sans inversion
Type de fixation
CMS
Type de boîtier
SSOP
Nombre de broche
8
Courant de sortie niveau haut maximum
-32mA
Tension de sortie niveau bas maximum
32mA
Délai de propagation maximum @ capacité de charge maximum
5.4 ns @ 3.3 V
Dimensions
2.95 x 2.8 x 1.29mm
Tension d'alimentation fonctionnement maximum
5.5 V
Taille
1.29mm
Largeur
2.8mm
Température de fonctionnement minimum
-40 °C
Tension d'alimentation de fonctionnement minimum
1.65 V
Température d'utilisation maximum
85 °C
Condition de test du délai du propagation
50pF
Longueur
2.95mm
Pays d'origine
Germany
Détails du produit
Famille 74LVC3G, Texas Instruments
Logique CMOS basse tension
Boîtier contenant une porte
Tension d'utilisation : 1,65 à 5,5 V
Compatibilité : Entrée LVTTL/TTL, Sortie LVCMOS
74LVC Family
€ 1 244,47
€ 0,415 Each (On a Reel of 3000) (hors TVA)
3000
€ 1 244,47
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Les informations sur le stock sont temporairement indisponibles.
3000
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Spécifications
Brand
Texas InstrumentsFamille logique
LVC
Fonction logique
Buffer à trigger de Schmitt
Nombre de canaux
3
Entrée de trigger de Schmitt
Yes
Type d'entrée
Single Ended
Polarité
Sans inversion
Type de fixation
CMS
Type de boîtier
SSOP
Nombre de broche
8
Courant de sortie niveau haut maximum
-32mA
Tension de sortie niveau bas maximum
32mA
Délai de propagation maximum @ capacité de charge maximum
5.4 ns @ 3.3 V
Dimensions
2.95 x 2.8 x 1.29mm
Tension d'alimentation fonctionnement maximum
5.5 V
Taille
1.29mm
Largeur
2.8mm
Température de fonctionnement minimum
-40 °C
Tension d'alimentation de fonctionnement minimum
1.65 V
Température d'utilisation maximum
85 °C
Condition de test du délai du propagation
50pF
Longueur
2.95mm
Pays d'origine
Germany
Détails du produit
Famille 74LVC3G, Texas Instruments
Logique CMOS basse tension
Boîtier contenant une porte
Tension d'utilisation : 1,65 à 5,5 V
Compatibilité : Entrée LVTTL/TTL, Sortie LVCMOS


