Récepteur LVDS, SN75LVDS86ADGG, 21 LVTTL, TSSOP, 48 broches
Documents techniques
Spécifications
Brand
Texas InstrumentsNombre de drivers
21
Type d'entrée
LVDS
Type de sortie
LVTTL
Interface
CI pour récepteur
Nombre d'éléments par circuit
3
Type de montage
CMS
Type de boîtier
TSSOP-16
Nombre de broche
48
Tension de seuil haute d'entrée différentielle
100mV
Tension de seuil basse d'entrée différentielle
-100mV
Dimensions
12.5 x 6.1 x 1.15mm
Taille
1.15mm
Longueur
12.5mm
Tension d'alimentation de fonctionnement maximale
3.6 V
Température de fonctionnement minimum
0° C
Température de fonctionnement maximum
+70 °C
Largeur
6.1mm
Tension d'alimentation de fonctionnement minimale
3 V
Détails du produit
Sérialiseur/désérialiseur FlatLink/FPD-Link, Texas Instruments
Emetteurs LVDS à utiliser avec les liaisons FPD de 24 bits (écran plat) fonctionnant à 65 et 85 MHz.
Entrées LVCMOS/LVTTL
Fonctionnement à faible alimentation de 3,3 V
Horloge de données d'émetteur PLL
Conforme à la norme TIA/EIA-644 LVDS
LVDS Communication
Low Voltage Differential Signaling, or LVDS, is an electrical signaling system that can run at very high speeds over cheap, twisted-pair copper cables.
Idée. Créer. Collaborer
S'INSCRIRE GRATUITEMENT
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Les informations sur le stock sont temporairement indisponibles.
Prix sur demande
Standard
1
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100mV
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Taille
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Tension d'alimentation de fonctionnement maximale
3.6 V
Température de fonctionnement minimum
0° C
Température de fonctionnement maximum
+70 °C
Largeur
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Détails du produit
Sérialiseur/désérialiseur FlatLink/FPD-Link, Texas Instruments
Emetteurs LVDS à utiliser avec les liaisons FPD de 24 bits (écran plat) fonctionnant à 65 et 85 MHz.
Entrées LVCMOS/LVTTL
Fonctionnement à faible alimentation de 3,3 V
Horloge de données d'émetteur PLL
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